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Type: Messages; Utilisateur: florentw

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    Vitis est prévu pour le développement sur une...

    Vitis est prévu pour le développement sur une plateforme. Donc les interfaces sont déjà définies. Vitis ne prévoit pas de remplacer Vivado qui sera toujours la pour définir la plateforme. Une fois la...
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    Bonjour Thibault, Mon premier conseil est...

    Bonjour Thibault,

    Mon premier conseil est d'utiliser les ressources "clocking" du FPGA lorsque tu "travaille" sur une horloge. Pour modifier la frequence d'une horloge, penses a utiliser une...
  3. Discussion: projet en vhdl

    par florentw
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    Bonjour, quelle est ta question? Florent

    Bonjour,

    quelle est ta question?

    Florent
  4. Discussion: Projet noc VHDL

    par florentw
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    Bonjour, Je ne comprends pas trop le lien...

    Bonjour,

    Je ne comprends pas trop le lien entre ton code et ton schematic... esaaye de prendre des noms plus parlants...(ex je ne comprends pas d'ou vienne nord/sud...)

    Je pense qu'il faudrait...
  5. Discussion: projet en vhdl

    par florentw
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    Premier lien sur google:...

    Premier lien sur google:
    http://www.ics.uci.edu/~jmoorkan/vhdlref/process.html
  6. Discussion: projet en vhdl

    par florentw
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    Ca se fait avec les process en vhdl. Regardes des...

    Ca se fait avec les process en vhdl. Regardes des exemples de process sur internet
  7. Discussion: projet en vhdl

    par florentw
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    Si tu veux garder l'état précédent des switches...

    Si tu veux garder l'état précédent des switches tu devras utiliser des bascule
  8. Discussion: projet en vhdl

    par florentw
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    Bonjour, Si le switch est ON -> la LED est...

    Bonjour,

    Si le switch est ON -> la LED est allumée.

    Ensuite tu peux essayer de faire que les LED affiches l'etat des LED du moment ou le bouton etait appuye (les LEDs gardes les etats des...
  9. Discussion: projet en vhdl

    par florentw
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    Bonjour, Commence par afficher l'etat des...

    Bonjour,

    Commence par afficher l'etat des switchs sur les LEDs.

    Ensuite pour la comparaison et garder l'etat des switchs il faut regarder les process en VHDL
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    Bonjour, Je pense qu'il faudrait que le...

    Bonjour,

    Je pense qu'il faudrait que le premier process soit aussi en fonction de clk et non combinatorial ou changer le second process par:

    process (clk)
    begin
    if rising_edge(clk) then
    ...
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    Ce livre est vraiment bien (Design for Embedded...

    Ce livre est vraiment bien (Design for Embedded Image Processing on FPGAs - Donald G. Bailey):
    http://www.wiley.com//legacy/wileychi/bailey/

    De souvenir il y a les exemples avec.

    Florent
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    Bonjour, "Théoriquement" en VHDL il est...

    Bonjour,

    "Théoriquement" en VHDL il est possible d'utiliser les multiplications (*) et les puissances (**) même les divisions. Mais ca ce n'est que pour la simulation. Dans le cas d'une...
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    Bonjour, Je suppose que tu fais une simulation...

    Bonjour,

    Je suppose que tu fais une simulation post-implementation?

    Il faut prendre en compte que les bits de compteur_num_p ne changent pas forcement tous a la même vitesse dans la réalité.
    ...
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