Bonjour
je suis un étudiant en master 2 informatique et j'ai un projet de transformation de modèles, plus en détails je dois transformer un diagramme de block sysml vers un modèle vhdl, je me suis un peux documenter et j'ai trouvé qu'il faut avoir les metamodel des modèles cible et source, est ce qu'ils existe des metamodel pour sysml et vhdl prédéfinie? ou faut il créer un pour chaque modéle et comment s'assurer que le modèle source par exemple créer avec topcased est conforme au metamodel et qu'elle est le langage de transformation le plus adapter.merci pour tous vos repenses
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