makefile pour plusieurs exécutables

Bonjour à tous.

Je suis confronté à un problème assez coriace.
Je développe un petit jeu vidéo façon stratégie tour par tour (dans le genre de Wesnoth), essentiellement pour le défi.

Au moment de le compiler, j'ai voulu faire un makefile.
Jusque là, pas de problème, il marche bien, et le code fonctionne à merveille.
Par contre, il me vient l'idée de concevoir un "visionneur d'unités", en réutilisant une grande partie du code.

Le problème est donc le suivant:
Puisque j'ai deux exécutables à construire, jeu et viewer, chacun utilisant les fichiers proches de unite.cpp (unite.hpp, modele.hpp/.cpp, unitebuffer.hpp/.cpp), comment établir le makefile pour compiler les deux sans lier tous les objets à chaque fois?

J'ai pensé au début à utiliser deux variables comme JEUSRC et VIEWERSRC, mais ce n'est pas viable.
Il doit y avoir une solution pour faire cela automatiquement. peut-être dans les auto-tools?

Merci d'avance.

Salut.

Tu peut faire dans un Makefile, des cibles différentes et indépendantes, exemple :

Code:

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1 2 3 4 5

#Makefile cible1: mkdir ~/dossier cible2: rm -r ~/dossier

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make tout court ou make cible1 fabriqueront la cible 1, c'est à dire création d'un dossier et make cible2 supprimera ce dossier.

Ou des cibles liées :

Code:

---

1 2 3 4 5

#Makefile cible1: mkdir ~/dossier cible2: cible1 rm -r ~/dossier

---

make cible2 fabriquera d'abord la cible 1 avant la cible 2 ...

Merci, mais c'est pas exactement à ca que je pensais.
j'aurais plutôt vu un truc dans le genre:

Code:

---

1 2 3 4 5 6 7 8 9 10

#makefile JEUOBJ=... VIEWEROBJ=... all:jeu viewer jeu : $(JEUOBJ) viewer: $(VIEWEROBJ) #définition des dépendances des .o #compilations de tous %.o:%.cpp $(CC) ...

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avec la définition de la liste des objets requis se construisant "toute seule"

Effectivement je pourrai ensuite faire make jeu ou make viewer.

Et en construisant une librairie commune au jeu et au viewer ?

C'est pas bête du tout comme solution ça. Je vais voir.