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LabVIEW Discussion :

[FPGA] transfert donnée FPGA -> RT via DMA


Sujet :

LabVIEW

  1. #1
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    Par défaut [FPGA] transfert donnée FPGA -> RT via DMA
    Bonjour, j'ai un petit soucis avec du transfert DMA :

    - Couche FPGA : acquisition de données simultanée de données -> transfert DMA
    Nom : FPGA.png
Affichages : 398
Taille : 9,0 Ko dans une boucle for avec un cadencement.

    - Couche RT : je dépile la DMA
    Nom : RT.png
Affichages : 371
Taille : 5,5 Ko
    Nom : RT-décimation.png
Affichages : 390
Taille : 4,9 Ko
    Dans une boucle cadencée.

    Problème, je loupe une donnée dans mon dépouillement et du coup les données dépilée ne sont plus dans l'ordre attendues ! Le problème c'est que lorsque je lance le programme, tout va bien et au bout d'un moment (aléatoire) ça déraille.

    Merci !

  2. #2
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    Par défaut Bonsoir,
    As tu programmé ton projet en Scan engine ou en FPGA classique ?

    Connais tu le temps de cycle de ta boucle, il est possible que tu n’aies pas le temps d'exécuter toutes les instructions, en dehors de ta boucle cadencée.

    Je ne suis pas sur d'avoir été clair ?

    Je ne sui pas un spécialiste labview, c'est juste un retour d'expérience .

    A+

    Nostra76

  3. #3
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    Par défaut
    J'avouerai ne pas avoir trop d'idées sur ce qui peut se passer. Un truc à tenter serait de mettre une valeur au time out de la DMA côté Host.
    Je ne réponds pas aux questions techniques via MP. Le but du forum est de permettre de trouver des solutions ensembles pour aider un ensemble de personnes.

    Loi du Chaos Informatique
    L’informatique, ça tient du chaos : une fois ça marche, une fois ça foire, tu sais pas pourquoi, c’est juste que tu viens de changer de lobe sur l’attracteur étrange.

  4. #4
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    Citation Envoyé par nostra76 Voir le message
    As tu programmé ton projet en Scan engine ou en FPGA classique ?

    Connais tu le temps de cycle de ta boucle, il est possible que tu n’aies pas le temps d'exécuter toutes les instructions, en dehors de ta boucle cadencée.

    Je ne suis pas sur d'avoir été clair ?

    Je ne sui pas un spécialiste labview, c'est juste un retour d'expérience .

    A+

    Nostra76

    Du coup je suis en FPGA (d'où le transfert en DMA).

    Le temps de cycle de mes boucles est maîtrisé. Pas de problème de ce côté là.

  5. #5
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    Un point qui m'interpelle au niveau de ton post :
    Problème, je loupe une donnée dans mon dépouillement
    Ta fonction pour le dépouillement est basique et fonctionnerait même pour d'autres applications. Est-ce que le problème ne viendrait pas de plus haut ?
    1/ Valider qu'il n'y a pas d'éléments restants dans la FIFO DMA, bien que j'y crois moyen étant donné que la FIFO prend des éléments de type tableau. Du coup, il ne me semble pas possible de perdre une donnée du tableau à ce niveau là...
    2/ Valider que tu ne perdes pas une donnée côté acquisition avant la mise en tableau...
    Je ne réponds pas aux questions techniques via MP. Le but du forum est de permettre de trouver des solutions ensembles pour aider un ensemble de personnes.

    Loi du Chaos Informatique
    L’informatique, ça tient du chaos : une fois ça marche, une fois ça foire, tu sais pas pourquoi, c’est juste que tu viens de changer de lobe sur l’attracteur étrange.

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