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VHDL Discussion :

Erreur de syntaxe


Sujet :

VHDL

  1. #1
    Candidat au Club
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    Par défaut Erreur de syntaxe
    Bonjour, lorsque je fait l'exécution il s'affiche
    vcom -work work -2002 -explicit -vopt C:/modeltech_6.5/examples/tstbznch.vhd
    Model Technology ModelSim SE vcom 6.5 Compiler 2009.01 Jan 22 2009
    -- Loading package standard
    ** Error: C:/modeltech_6.5/examples/tstbznch.vhd(2): near "EOF": syntax error

  2. #2
    Membre expérimenté

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    Par défaut
    Alors traduction:

    "error" -> erreur
    "near" -> à cotes de / pas loin de
    "syntax error" -> erreur de syntaxe

    =>

    Erreur : dans le fichier C:/modeltech_6.5/examples/tstbznch.vhd(2) pas loin de " EOF" : erreur de syntaxe

    Est-ce que c'est plus clair??

  3. #3
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    Par défaut
    Bonsoir,

    Version 6.5 => un peu (beaucoup) vieux. De mémoire, il me semble qu'il était un peu tatillon sur l'absente d'une ligne vide en fin de fichier (un peu comme certains compilateurs C).
    Par contre, êtes-vous sûr de votre fichier : EOF (End Of File) dès la 2ème ligne !! J'ai bien envie de la faire à la Cyrano :

    "Ah ! Non ! C'est un peu court, jeune homme !
    On pouvait dire... oh ! Dieu ! ... bien des choses en somme..."

    Cdlt

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